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應(yīng)用分布式算法在FPGA平臺(tái)實(shí)現(xiàn)FIR低通濾波器
李明緯 黃世震
(福州大學(xué) 福建省微電子集成電路重點(diǎn)實(shí)驗(yàn)室福州 350002)
摘要：在利用FPGA實(shí)現(xiàn)數(shù)字信號(hào)處理方面，分布式算法發(fā)揮著關(guān)鍵作用，與傳統(tǒng)
的乘加結(jié)構(gòu)相比，具有并行處理的高效性特點(diǎn)。本文研究了一種16階FIR濾波器的
FPGA設(shè)計(jì)方法，采用Verilog HDI語言描述設(shè)計(jì)文件，在Xilinx ISE 7.1i及ModelSim
SE 6.1b平臺(tái)上進(jìn)行了實(shí)驗(yàn)仿真及時(shí)序分析，并探討了實(shí)際工程中硬件資源利用率及
運(yùn)算速度等問題。
關(guān)鍵詞：FIR濾波器、FPGA、分布式算法、窗函數(shù)、Verilog HDL
李明緯 黃世震
(福州大學(xué) 福建省微電子集成電路重點(diǎn)實(shí)驗(yàn)室福州 350002)
摘要：在利用FPGA實(shí)現(xiàn)數(shù)字信號(hào)處理方面，分布式算法發(fā)揮著關(guān)鍵作用，與傳統(tǒng)
的乘加結(jié)構(gòu)相比，具有并行處理的高效性特點(diǎn)。本文研究了一種16階FIR濾波器的
FPGA設(shè)計(jì)方法，采用Verilog HDI語言描述設(shè)計(jì)文件，在Xilinx ISE 7.1i及ModelSim
SE 6.1b平臺(tái)上進(jìn)行了實(shí)驗(yàn)仿真及時(shí)序分析，并探討了實(shí)際工程中硬件資源利用率及
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關(guān)鍵詞：FIR濾波器、FPGA、分布式算法、窗函數(shù)、Verilog HDL
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