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提出一種新的高階FIR濾波器的FPGA實現方法。該方法運用多相分解結構對高階FIR濾波器進行降階處理，采用改進的分布式算法來實現降階后的FIR濾波器。設計了一系列階數從8到1 024的FIR濾波器，通過Quartus II 7．1的綜合與仿真，以及在EP2S60F1020C4 FPGA目標器件上的實現結果表明，該方法能夠有效地減少硬件資源的使用且滿足高速實時性的要求。
FIR濾波器因其具有線性相位、穩定等優點，在軟件無線電、數字雷達、移動通信、醫療儀器等領域有廣泛的應用，一直是大家研究的焦點。FPGA是物理級編程結構的可編程邏輯器件，其基本結構由4輸入的查找表構成，如何在FPGA上實現高階高效FIR濾波器成為—個很現實的問題。
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