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介紹介紹滿足高速數模轉換器 (DAC) 的數字時序要求對于實現最佳性能至關重要。隨著時鐘頻率的增加，數據接口的設置和保持時間成為系統設計人員的重要關注點。本應用筆記旨在全面解釋與 Maxim 高性能轉換器解決方案相關的建立和保持時間。滿足高速數模轉換器 (DAC) 的數字時序要求對于實現最佳性能至關重要。隨著時鐘頻率的增加，數據接口的設置和保持時間成為系統設計人員的重要關注點。本應用筆記旨在全面解釋與 Maxim 高性能轉換器解決方案相關的建立和保持時間。定義建立時間和保持時間定義建立時間和保持時間建立時間 (t 建立時間 (t SS ) 描述了數據必須處于相對于 DAC 時鐘轉換的有效邏輯電平的時間點。另一方面，保持時間 (t ) 描述了數據必須處于相對于 DAC 時鐘轉換的有效邏輯電平的時間點。另一方面，保持時間 (t H ) 指定數據在被設備捕獲/采樣后何時可以更改。H ) 指定數據在被設備捕獲/采樣后何時可以更改。圖 1圖 1顯示了參考上升沿時鐘信號的建立和保持時間。特定器件時鐘信號的有效邊沿可以是上升沿/下降沿，也可以是用戶可選的，如 MAX5895 16 位、500Msps 內插和調制雙通道 DAC，具有 CMOS 輸入。顯示了參考上升沿時鐘信號的建立和保持時間。特定器件時鐘信號的有效邊沿可以是上升沿/下降沿，也可以是用戶可選的，如 MAX5895 16 位、500Msps 內插和調制雙通道 DAC，具有 CMOS 輸入。圖 1. 參考上升沿時鐘信號的建立和保持時間。圖 1. 參考上升沿時鐘信號的建立和保持時間。采用 CMOS 技術設計的數字電路通常在電源軌之間的電壓中間切換。因此，時間參考標記位于信號邊緣的中點。圖 1 中波形的位置展示了這種建立和保持時間的典型條件。請注意，此設置的兩個參數均為正值。當設置時間或保持時間的指定值為負時，可能會出現混淆。采用 CMOS 技術設計的數字電路通常在電源軌之間的電壓中間切換。
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