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DDR=Double Data Rate雙倍速率同步動態隨機存儲器。嚴格的說DDR應該叫DDR SDRAM，人們習慣稱為DDR，其中，SDRAM 是Synchronous Dynamic Random Access Memory的縮寫，即同步動態隨機存取存儲器。
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DDR的歷史，就是一個SI技術變革的過程，說白了就是拓撲與端接之爭。DDR2使用的是T拓撲，發展到DDR3，引入了全新的菊花鏈—fly-by結構。使用f...
高速先生前幾期的自媒體文章里多次提到了時序，并且也寫了很多時序方面的文章，這些文章都從不同的角度對時序的概念進行了闡述。作者讀完之后深受啟發，這里，作者...
你是否長時間糾纏于線路板的失效分析？你是否花費大量精力在樣板調試過程中？你是否懷疑過自己的原本正確的設計？也許許多硬件工程師都有過類似的心理對話。有數據...
作者：GRL實驗室/曾威華 Wing Tseng 在開始介紹 DDR 之前，首先要了解內存的功用為何。大多數的 3C 產品在運作時，會將正在使用的程式存...
2020年7月，DDR 5新標準誕生，令人興奮的DDR5技術保證了更高的數據速率和更低的功耗。這是接口設計人員熟悉的承諾。但是，就像生活中的大多數事情一...
本篇主要針對Zynq UltraScale + MPSoC的DDR接口，從硬件設計的角度進行詳細介紹，最后展示一下小編之前自己設計的基于ZU+的外掛8顆...
作者：Hello,Panda Zynq UltraScale+MPSoC是Xilinx推出的第二代多處理SoC系統，在第一代Zynq-7000的基礎上做...
在FPGA上如何使用non-blocking cache設計框架
帶寬是影響FPGA加速器的重要因素，因為大量的并行計算對數據量要求很大。如果加速器對數據的訪問是不規則的，那么cache miss就會大大影響加速器性能...
作者：Wilson Qiu，Xilinx工程師 ZYNQ對Memory的操作 參考工程見ZYBO_Memory_GPIO_Interrupt_demo....
通過修改lscript.ld文件中的內容，可以改變在存儲器中的執行位置， 因為ELF文件是加載到DDR中執行的，所以兩個DDR地址不能重合
DDR對于做項目來說，是必不可少的。一般用于數據緩存和平滑帶寬。今天介紹下Xilinx DDR控制器MIG IP核的例化及仿真。 FPGA芯片：XC7K...
要是我們將電路板中的線路設計成直線，那么這個轉彎的角度就達到了九十度。因為線路在九十度轉彎時很容易就產生反射，這樣的電路板在生產的過程中很容易就會被折斷。
約束流程 說到FPGA時序約束的流程，不同的公司可能有些不一樣。反正條條大路通羅馬，找到一種適合自己的就行了。從系統上來看，同步時序約束可以分為系統同步...
某些應用程序小，可以全部放在Zynq-7000的256KB OCM上運行。這時，修改FSBL，可以把APP和FSBL編譯成一個可執行文件，FSBL初始化...
有些應用中，單板沒有DDR，OCM又不夠存儲所有數據和指令。這種情況下，Xilinx提供了參考設計Zynq-7000 AP SoC Boot - Boo...
Xilinx的開發板ZCU102支持休眠到內存（suspend-to-ram）。休眠到內存時，DDR進入自刷新，MPSoC被關電，完全不耗電。喚醒時，M...
標準 DDR 面向服務器、云計算、網絡、筆記本電腦、臺式機和消費類應用，支持更寬的通道寬度、更高的密度和不同的形狀尺寸。DDR4 是這一類別目前最常用的...
選擇合適的存儲器解決方案是滿足目標系統對各種應用（從云計算和人工智能 （AI），再到汽車和移動應用）的功能和性能要求的關鍵。
DDR5 是第五代 DDR SDRAM 的簡稱，DDR SDRAM 是英文 Double Data Rate SDRAM 的縮寫，中文譯為雙倍速率 SD...
數據信號與DQS做等長。為啥要做等長？大家會說是要讓同組信號同時到達接收端，好讓接收芯片能夠同時處理這些信號。
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