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First Input First Output的縮寫，先入先出隊列，這是一種傳統的按序執行方法，先進入的指令先完成并引退，跟著才執行第二條指令。

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fifo技術

FIFO最小深度計算的方法

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抓取SEM IP的串口log的詳細步驟

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異步FIFO設計原理及應用需要分析

在大規模ASIC或FPGA設計中，多時鐘系統往往是不可避免的，這樣就產生了不同時鐘域數據傳輸的問題，其中一個比較好的解決方案就是使用異步FIFO來作不同...

2022-03-09 標簽：fpga asic fifo 2971 0

【紫光同創國產FPGA教程】【第二十七章】千兆以太網視頻傳輸實驗

本原創教程由芯驛電子科技（上海）有限公司（ALINX）創作，版權歸本公司所有，如需轉載，需授權并注明出處（ http://www. alinx.com ...

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【ZYNQ Ultrascale+ MPSOC FPGA教程】第八章FPGA片內FIFO讀寫測試實驗

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基于CS61575和CS61574A的抖動衰減設計

本應用筆記介紹了CS61575和CS61574A的抖動衰減性能。它介紹了抖動衰減器電路的描述以及衰減器設計的性能含義。抖動衰減器電路說明本節介紹CS...

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本文介紹稀疏LSTM的硬件架構，一種是細粒度稀疏化，權重參數分布隨機，另外一種是bank-balance稀疏化。 1. 文章結構 Long-short ...

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STM32F429芯片帶FIFO的DMA傳輸實現過程

STM32系列芯片都內置DMA外設，其中很多系列的DMA配備了FIFO。這里以STM32F429芯片及開發板為例，演示一下帶FIFO的DMA傳輸實現過程。

2020-09-04 標簽：fifo dma STM32F429 7557 0

基于FPGA器件實現復用器輸入部分的設計方案

整個傳送流的復用器分為復用預處理、輸入和復用3部分。預處理部分是對多路傳送流的PSI（節目特殊信息）提取并修改，重新生成新的PSI表的過程；輸入部分是給...

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基于XC3S400PQ208 FPGA芯片實現異步FIFO模塊的設計

隨著數字電子系統設計規模的擴大，一些實際應用系統中往往含有多個時鐘，數據不可避免地要在不同的時鐘域之間傳遞。如何在異步時鐘之間傳輸數據，是數據傳輸中一個...

2020-07-21 標簽：fpga 存儲器 fifo 1687 0

12位并行高速A/D轉換芯片THS1206的功能構造和工作原理分析

ＴＨＳ１２０６有４個模擬信號輸入端，每個輸入端既可作為４個單獨的非極性信號的輸入通道，也可作為２個差分信號輸入通道，而且兩種方式可同時混合使用，具體的輸...

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異步 FIFO 讀寫分別采用相互異步的不同時鐘。在現代集成電路芯片中，隨著設計規模的不斷擴大，一個系統中往往含有數個時鐘，多時鐘域帶來的一個問題就是，如...

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基于DDR DRAM控制器實現MPMA存取輸入/輸出端口的設計

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TNT4882是美國NI公司的一款單芯片、高速、聽/講功能的兼備的GPIB（General purpose interface bus）接口專用芯片。它...

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焊縫缺陷自動超聲檢測系統是一種重要的無損探傷設備，可用于檢測平板、管道、容器等的縱、橫焊縫以及接管角焊縫缺陷。與手工檢測方法相比，該系統具有運行平穩、漏...

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USB技術的應用已經從最初應用為一種連接外設和PC的方法經過了長足的發展。USB標準的靈活性和適應性，加上目前流行的基于USB的存儲設備和音樂播放器，激...

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為了達到可靠的數據傳輸，借助存儲器來完成跨時鐘域通信也是很常用的手段。在早期的跨時鐘域設計中，在兩個處理器間添加一個雙口RAM或者FIFO來完成相互間的...

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