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FPGA IP核開發流程概要

開發和驗證 FPGA IP 不僅僅是編寫 HDL，而是需要更多的思考。讓我們來看看如何做吧！

2023-10-17 標簽：fpga 接口 HDL 1193 0

利用同步fifo實現對輸入序列的檢測

今天繼續為大家解析聯發科技數字IC設計崗的筆試題。

2022-09-14 標簽：fifo Verilog HDL 1166 0

FPGA基礎知識及設計和執行FPGA應用所需的工具

本文將首先介紹FPGA的基礎知識，包括FPGA的工作原理以及為什么要使用FPGA等，然后討論設計和執行FPGA應用所需的工具。

2024-11-11 標簽：FPGA HDL 現場可編程門陣列 1156 0

芯片設計全流程概述

使用硬件描述語言（VHDL，Verilog HDL，業界公司一般都是使用后者）將模塊功能以代碼來描述實現，也就是將實際的硬件電路功能通過HDL語言描述出...

2023-07-09 標簽：機器人芯片設計仿真 1135 0

Vivado HDL編寫示例

Vivado 軟件提供了HDL編寫中常用的示例，旨在幫助初學者更好地理解和掌握HDL編程，這里分享一下verilog代碼示例。

2023-05-16 標簽：寄存器 HDL 鎖存器 1116 0

通用HDL的技術特性

各種硬件描述語言 (HDL) 在過去幾年中不斷增強，確定哪種語言適合哪種設計的復雜性也隨之增加。許多設計人員和組織正在考慮是否應該從一種 HDL 切換到...

2022-11-02 標簽：硬件 HDL 仿真控制 1104 0

FPGA設計總結十五條

Verilog作為一種HDL語言，對系統行為的建模方式是分層次的。比較重要的層次有系統級（system）、算法級（Algorithm）、寄存器傳輸級（R...

2023-03-06 標簽：fpga Verilog HDL 1100 0

簡談FPGA引腳信號分配的幾個原則

現在的FPGA正變得越來越復雜，向引腳分配信號的任務曾經很簡單，現在也變得相當繁復。下面這些用于向多用途引腳指配信號的指導方針有助于設計師根據最多到最少...

2023-05-04 標簽：fpga 信號 HDL 1094 0

Verilog HDL之步進電機驅動控制

步進電機的用途還是非常廣泛的，目前打印機，繪圖儀，機器人等等設備都以步進電機為動力核心。那么，下面我們就了解下什么是步進電機，它是怎么控制的。

2023-03-17 標簽：電動機步進電機 Verilog 1054 0

Verilog HDL指定用戶定義原語UDP的能力

在前一章中，我們介紹了Verilog HDL提供的內置基本門。本章講述Verilog HDL指定用戶定義原語U D P的能力。

2022-08-08 標簽：Verilog HDL UDP 1053 0

在SpinalHDL中如何將ROM的初始化放置在RTL文件中？

在默認情況下，SpinalHDL在生成代碼時會同時生成一個bin文件及一個RTL代碼文件。在RTL代碼中，會通過readmemb函數來載入初始化內容

2023-04-01 標簽：ROM HDL RTL 1044 0

HDL開發的10大規則是什么

編寫良好的、可移植的、可重用的 HDL 代碼，使設計能夠以所需的頻率實現，這絕對是一個挑戰。

2022-09-29 標簽：fpga HDL 狀態機 1009 0

FPGA設計的經驗技巧

當然，任何編程語言的學習都不是一朝一夕的事，經驗技巧的積累都是在點滴中完成，FPGA設計也無例外。下面就以我的切身體會，談談FPGA設計的經驗技巧。

2022-10-25 標簽：FPGA設計 HDL 編程語言 998 0

如何寫出時序最優的HDL代碼？如何寫出時序裕量足夠的代碼？

你想寫出可以跑出700M以上的代碼嗎，直逼FPGA內部PLL的極限。

2024-03-12 標簽：FPGA 濾波器比較器 985 0

ASIC數字設計：前端設計、驗證、后端實現

數字系統設計中有三個重要的設計級別概念：行為級（Behavior Level）、寄存器傳輸級（Register Transfer Level）和門級（G...

2023-07-02 標簽：asic Verilog HDL 975 0

決策語句允許程序塊的執行流程

SystemVerilog case語句與C switch語句類似，但有重要區別。SystemVerilog不能使用break語句（C使用break從s...

2022-10-27 標簽：硬件 HDL 編碼 961 0

FPGA編程語言之verilog語法1

Verilog HDL是一種用于數字系統設計的語言。用Verilog HDL描述的電路設計就是該電路的Verilog HDL模型也稱為模塊。Verilo...

2023-05-22 標簽：元器件 Verilog HDL 936 0

如何合理高效地使用狀態機呢？

今天還是更新狀態機，狀態機基本是整個HDL中的核心，合理、高效地使用狀態機，是數字電路中的重要技能。

2023-02-12 標簽：HDL 狀態機 fsm 936 0

Verilog代碼封裝后門訪問

關于仿真里的后門訪問，之前的文章《三分鐘教會你SpinalHDL仿真中的后門讀寫》中有做過介紹，其針對的都是針對以SpinalHDL中的代碼進行的后門訪...

2023-07-15 標簽：封裝仿真 Verilog 923 0

灰度圖像均值濾波算法的HDL實現介紹

首先要做的是最簡單的均值濾波算法。均值濾波是典型的線性濾波算法，它是指在圖像上對目標像素給一個模板，該模板包括了其周圍的臨近像素（以目標象素為中心的周圍...

2023-10-16 標簽：RAM HDL 移位寄存器 903 0

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