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一種具有顯著優點的光固化通道數字微流控芯片（pCDMF）開發

數字PCR（dPCR）是一種用于核酸絕對定量的強大技術，具有超高靈敏度。

2024-01-04 標簽：HDL 微流控芯片 PCR 1219 0

芯片設計分為哪些步驟？為什么要分前端后端？前端后端是什么意思

芯片設計分為哪些步驟？為什么要分為前端后端？前端后端分別是什么意思？芯片設計分為前端和后端兩個主要步驟。前端設計由邏輯設計和驗證組成，后端設計則包括物...

2023-12-07 標簽：芯片設計 HDL 4178 0

什么叫可編程邏輯器件可編程邏輯器件有哪些特征和優勢？

可編程邏輯器件（Programmable Logic Device，PLD）是一類集成電路器件，可以根據用戶的需求進行編程和配置，以實現特定的邏輯功能。...

2023-09-14 標簽：集成電路 cpld PLD 3036 0

一枚使用ChatGPT設計的芯片?

“Chipchat”讓普通人可以設計芯片。

2023-06-19 標簽：微處理器 HDL 人工智能 542 0

Vitis? Model Composer 2023.1現已更新

Vitis Model Composer 是一個基于模型的設計工具，不僅可在 MathWorks MATLAB 和 Simulink 環境中進行快速設計...

2023-05-31 標簽：HDL Simulink 模型 2040 0

在線學習SystemVerilog：移位寄存器

設計一個100bit的可左移或右移的移位寄存器，附帶同步置位和左移或右移的使能信號。本題中，移位寄存器在左移或右移時，不同于Problem106的補0和...

2022-12-09 標簽：HDL 時序電路移位寄存器 2223 0

16nm技術的形式驗證流程、優勢和調試

必須優化正式驗證流程中的初始網表，因此測試設計需要額外的邏輯。在這里，我們提供16 nm節點的形式驗證流程和調試技術。

2022-11-24 標簽：HDL 代碼 1414 0

FPGA設計的經驗技巧和基本知識

反之，如果一個設計的時序要求很高，普通方法達不到設計頻率，那么可以通過數據流串并轉換，并行復制多個操作模塊，對整個設計采用“乒乓操作”和“串并轉換”的思...

2022-11-17 標簽：fpga HDL 970 0

Verilog HDL高級數字設計

第一句話是：還沒學數電的先學數電。然后你可以選擇verilog或者VHDL，有C語言基礎的，建議選擇VHDL。因為verilog太像C了，很容易混淆，最...

2022-11-03 標簽：Verilog HDL 編譯器 3907 0

FPGA開發流程的物理含義和實現目標

從圖1 FPGA開發流程中的主干線上分離出第一步設計輸入橫向環節，并做了進一步的細節的處理，如圖2，從圖上看到，設計輸入方式有三種形式，有IP核、原理圖...

2022-09-20 標簽：fpga ASIC設計 HDL 1064 0

推薦一款網頁版的Verilog代碼編輯仿真驗證平臺

打開后的界面如下圖所示，全英文顯示。如果感覺自己的英文水平欠佳，可以使用谷歌瀏覽器打開該網頁，并選擇在線翻譯功能，翻譯的正確率還是很高的。

2022-09-19 標簽：fpga Verilog HDL 1.1萬 0

使用Verilog/SystemVerilog硬件描述語言 (HDL) 練習數字硬件設計

給出了一個可以做16bit加法的模塊add16，實例化兩個add16以達到32bit加法的。

2022-09-15 標簽：Verilog HDL 加法器 1856 0

基于硬件描述語言HDL的FPGA開發

基于硬件描述語言HDL，抽象出HLS（High-Level Synthesis)（翻譯為高層次綜合？怎么聽起來都沉得別扭）技術，通過高層設計去隱藏很多底...

2022-09-05 標簽：fpga asic HDL 897 0

FPGA布線為什么會擁塞呢？如何解決呢

此類問題是FPGA設計實現中比較棘手的問題，Xilinx針對7系列及以后的UltraScale/UltraScale+等，提出了UltraFast設計方...

2022-08-25 標簽：fpga HDL CLB 1667 0

Verilog基礎知識

對于Verilog描述初學者來說，最難的莫過于編寫測試代碼并判斷自己寫的是否正確。在這里我推薦一個HDL描述練習網站，這個網站上的練習題無需自己編寫測試...

2022-08-03 標簽：Verilog HDL 代碼 966 0

需要需求可追溯性的五個主要原因

這為考慮Spec-Tracer改進變更管理、促進更好的項目管理以及提供組織、連接和跟蹤 FPGA 開發周期的有效方式提供了另一個理由。

2022-06-29 標簽：fpga HDL 2980 0

硬件開源編程利器MyHDL簡介

自從1995年Verilog HDL 1364-1995標準發布至今已經20多年了，說他經久不衰并不恰當，主要是沒有新的語言可以替代，現今數字電路高速發...

2022-03-14 標簽：Verilog HDL 編譯 2005 0

Vivado HLS從HDL到模型和C的描述

先從運行一個創建一個項目開始吧。

2022-02-26 標簽：HDL 模型 Vivado 1485 0

簡述Verilog HDL中阻塞語句和非阻塞語句的區別

? 在Verilog中有兩種類型的賦值語句：阻塞賦值語句（“=”）和非阻塞賦值語句（“=”）。正確地使用這兩種賦值語句對于Verilog的設計和仿真非常...

2021-12-02 標簽：Verilog HDL 阻塞 6327 0

Windows下Modelsim安裝步驟

1. 軟件基本介紹軟件基本介紹： Modelsim 是 Model Technology（Mentor Graphics 的子公司）的 HDL 硬件...

2021-11-09 標簽：WINDOWS 仿真器 HDL 5885 0

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