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標簽 > ModelSim
Mentor公司的ModelSim是業界最優秀的HDL語言仿真軟件,它能提供友好的仿真環境,是業界唯一的單內核支持VHDL和Verilog混合仿真的仿真器。它采用直接優化的編譯技術、Tcl/Tk技術、和單一內核仿真技術,編譯仿真速度快,編譯的代碼與平臺無關,便于保護IP核,個性化的圖形界面和用戶接口,為用戶加快調錯提供強有力的手段,是FPGA/ASIC設計的首選仿真軟件。
Mentor公司的ModelSim是業界最優秀的HDL語言仿真軟件,它能提供友好的仿真環境,是業界唯一的單內核支持VHDL和Verilog混合仿真的仿真器。它采用直接優化的編譯技術、Tcl/Tk技術、和單一內核仿真技術,編譯仿真速度快,編譯的代碼與平臺無關,便于保護IP核,個性化的圖形界面和用戶接口,為用戶加快調錯提供強有力的手段,是FPGA/ASIC設計的首選仿真軟件。
Mentor公司的ModelSim是業界最優秀的HDL語言仿真軟件,它能提供友好的仿真環境,是業界唯一的單內核支持VHDL和Verilog混合仿真的仿真器。它采用直接優化的編譯技術、Tcl/Tk技術、和單一內核仿真技術,編譯仿真速度快,編譯的代碼與平臺無關,便于保護IP核,個性化的圖形界面和用戶接口,為用戶加快調錯提供強有力的手段,是FPGA/ASIC設計的首選仿真軟件。
主要特點
· RTL和門級優化,本地編譯結構,編譯仿真速度快,跨平臺跨版本仿真;
· 單內核VHDL和Verilog混合仿真;
· 源代碼模版和助手,項目管理;
· 集成了性能分析、波形比較、代碼覆蓋、數據流ChaseX、Signal Spy、虛擬對象Virtual Object、Memory窗口、Assertion窗口、源碼窗口顯示信號值、信號條件斷點等眾多調試功能;
· C和Tcl/Tk接口,C調試;
· 對SystemC的直接支持,和HDL任意混合;
· 支持SystemVerilog的設計功能;
· 對系統級描述語言的最全面支持,SystemVerilog,SystemC,PSL;
· ASIC Sign off。
· 可以單獨或同時進行行為(behavioral)、RTL級、和門級(gate-level)的代碼。
電子發燒友網核心提示:對于FPGA初學者而言,如何正確了解并理解FPGA的仿真是關鍵。應廣大FPGA初學者和愛好者要求,電子發燒友網編輯根據多名在FPG...
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2017-11-24 標簽:modelsim 4.6萬 0
在數字電路設計中(Verilog or VHDL),ModelSim是常用的仿真工具。當我們仿真大型的工程時,往往需要保留仿真波形,以便分析和以后查看。...
2017-11-24 標簽:ModelSim 1.7萬 0
最近在Modelsim仿真過程中,遇到一個大問題,對于分辨率2048*500的圖像數據,在進行時序約束中,發現算法模塊最高只能跑到60Mhz多,而要求必...
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Vivado自帶的仿真,個人覺得跑一些小模塊的仿真還是可以的,不過跑大的仿真系統,容易無體驗感,建議用第三方工具,這邊就直接對ModelSim下手了,接...
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