基于CMOS的非門、與非門、或非門設計
利用CMOS設計電路需先自行學習NMOS和PMOS的基本原理。
1、非電路設計
如圖所示，非電路由一個PMOS和一個NMOS組成。 當uI=0，PMOS管導通，NMOS管關斷，u0約等于VDD,為高電平; 當uI=VDD，PMOS管關斷，NMOS管導通，u0約等于0，為低電平;
2、與非門設計
如圖所示，與非門設計包含兩個PMOS和兩個NMOS。 兩個PMOS并聯，實現A、B兩個任何一個為0，都能導通，使Y輸出高電平。 兩個NMOS串聯，實現A、B兩個同時為VDD，才能導通，使Y輸出低電平。 下表中1代表VDD高電平，0代表低電平
| A | B | Y |
| 1 | 1 | 0 |
| 1 | 0 | 1 |
| 0 | 1 | 1 |
| 0 | 0 | 1 |
3、或非門
如圖所示，或非門設計包含兩個PMOS和兩個NMOS。 兩個PMOS串聯聯，實現A、B兩個同時為0，才能導通，使Y輸出高電平。 兩個NMOS串聯，實現A、B兩個任何一個為VDD，就能導通，使Y輸出低電平。 下表中1代表VDD高電平，0代表低電平
審核編輯：湯梓紅
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原文標題：基于CMOS的非門、與非門、或非門設計
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