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介紹了一種用于高速ADC 的低抖動(dòng)時(shí)鐘穩(wěn)定電路。這個(gè)電路由延遲鎖相環(huán)(DLL)來(lái)
實(shí)現(xiàn)。這個(gè)DLL 有兩個(gè)功能：一是通過(guò)把一個(gè)時(shí)鐘沿固定精確延遲半個(gè)周期，再與另一個(gè)沿組成一個(gè)新的時(shí)鐘來(lái)調(diào)節(jié)時(shí)鐘占空比到50％左右；二是調(diào)節(jié)時(shí)鐘抖動(dòng)。該電路采用0.35μ CMOS 工藝，在Cadence Spectre 環(huán)境下進(jìn)行仿真驗(yàn)證，對(duì)一個(gè)8 bit、250 Msps 采樣率的ADC，常溫下得到的時(shí)鐘抖動(dòng)小于0.25 ps rm8(典型的均方根)。
實(shí)現(xiàn)。這個(gè)DLL 有兩個(gè)功能：一是通過(guò)把一個(gè)時(shí)鐘沿固定精確延遲半個(gè)周期，再與另一個(gè)沿組成一個(gè)新的時(shí)鐘來(lái)調(diào)節(jié)時(shí)鐘占空比到50％左右；二是調(diào)節(jié)時(shí)鐘抖動(dòng)。該電路采用0.35μ CMOS 工藝，在Cadence Spectre 環(huán)境下進(jìn)行仿真驗(yàn)證，對(duì)一個(gè)8 bit、250 Msps 采樣率的ADC，常溫下得到的時(shí)鐘抖動(dòng)小于0.25 ps rm8(典型的均方根)。
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