PCIe 7.0最終版草案發布，傳輸速率128 GT/s，PCIe 6.0加速商業化
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電子發燒友網綜合報道，近日，PCI-SIG 組織公布了 PCI Express 7.0 規范的0.9 版草案，這是PCIe 7.0規范正式版本發布前的最后一個草案版本，而正式版將于2025年晚些時候發布。
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其核心技術參數目標包括：傳輸速率128 GT/s，x16 配置下雙向帶寬達 512 GB/s；采用四電平脈沖幅度調制（PAM4）技術；，優化信道設計參數，確保在更長的物理距離下仍能保持高數據傳輸速率和穩定性；繼續改善低延遲性能，并強化系統的魯棒性和數據傳輸的準確性，以適應對實時性和數據完整性要求極高的應用場景；優化功耗效率指標；以及繼續向下兼容歷代 PCIe 版本。
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全新的PCIe 7.0 規范旨在支持數據密集型細分市場，例如超大規模數據中心、高性能計算 （HPC） 和軍事/航空航天，以及 AI/ML、800G 以太網和云計算等新興應用。該規范旨在為下一代計算設備提供更高帶寬基礎，滿足日益增長的實時數據處理與高速互聯需求。
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在PCIG-SIG DevCon 2024開發者大會上，Cadence全球首次展示了PCIe 7.0的全新方向，加入自己獨有的光學連接方案，在一個真實、低延遲、無需重定時、線性光學連接的系統中，跑出了128GT/s的收發速率。這就意味著，它的x16雙向帶寬可達512GB/s。
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在PCI-SIG DevCon 2024 上，新思科技展示了全球首個基于光學的 PCIe 7.0 IP，展示了該技術在實際場景中的功能。其中包括使用 OpenLight 光子 IC 以 128 Gb/s 運行的 Synopsys PCI Express 7.0 PHY IP 電-光-電 (EOE) TX 到 RX，以及使用 Synopsys PCIe 7.0 控制器 IP 成功實現根復合體到端點的連接和 FLIT 傳輸。
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Rambus也在PCI-SIG DevCon上推出PCIe 7.0 IP 產品組合，PCIe 7.0 控制器旨在提供下一代 AI 和 HPC 應用所需的高帶寬、低延遲和強大性能。主要特性包括支持 PCIe 7.0 規范，包括 128 GT/s 數據速率；實施低延遲前向糾錯 (FEC) 以實現鏈路穩健性；支持固定大小的 FLIT，可實現高帶寬效率；向后兼容 PCIe 6.0、5.0、4.0 等；借助 IDE 引擎實現最先進的安全性；支持 AMBA AXI 互連。此外，PCIe 7.0 重定時器，用于高度優化、低延遲信號再生數據路徑；PCIe 7.0 多端口交換機具有物理感知能力，可支持多種架構。
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隨著數據傳輸速率的不斷提高，傳統的電氣信號傳輸面臨著信號衰減、干擾等問題，難以滿足高速數據傳輸的需求。而光信號具有傳輸速度快、損耗低、抗干擾能力強等優點，因此將光學技術引入 PCIe 7.0 成為了解決高速數據傳輸問題的關鍵。早前，PCI-SIG組織就成立了專門的光學工作組，研究基于光學接口的PCIe新標準，但尚未確定PCIe 7.0是否一定采用光學方案。
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當然從市場端來看，當前PCIe 5.0逐漸成為市場主流，PCIe 6.0的研發成果陸續推出，但落地商用還需要一段時間。
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例如，去年在FMS 上，美光展示其領先的 PCIe 6.0 SSD 技術，其順序讀取帶寬超過 26GB/s，為推動生態系統發展而設計。美光將向合作伙伴提供此項技術，以加速 PCIe 6.0 生態系統的發展。
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在DesignCon2025大會上，Astera Labs演示了業界首個PCIe 6.0交換機與PCIe 6.0 SSD端點之間的互操作性，展示了其PCIe交換機與美光SSD配合使用時的能力。演示中使用的美光PCIe 6.0數據中心SSD實現了高達27GB/s的性能，遠超 PCIe 5.0 的 14.5 GB/s，展示了 PCIe 6.0 在存儲領域的巨大潛力。
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